El Módulo SDR M.2 2230 xSDR para 2×2 MIMO amplía el rango de 30 MHz a 3,8 GHz, alcanza hasta 122,88 MSPS y combina FPGA Artix-7 con transceptor LMS7002M en solo 30 × 22 mm.
El nuevo xSDR de Wavelet Lab es un módulo SDR en formato M.2 2230 diseñado para su integración directa en portátiles, SBC y sistemas de edge computing.
La propuesta amplía las capacidades del anterior uSDR al incorporar soporte 2×2 MIMO y un rango de frecuencia extendido dentro de un diseño de una sola cara.
El núcleo RF se basa en el transceptor programable LMS7002M de Lime Microsystems junto con una FPGA Artix-7 XC7A50T de AMD Embedded que integra 52.160 celdas lógicas.
Dicha combinación permite una sintonización continua desde 30 MHz hasta 3,8 GHz con un ancho de banda configurable entre 0,5 y 90 MHz.
Prestaciones RF y muestreo para LTE, 5G y análisis de espectro
En modo SISO, el módulo admite tasas de muestreo desde 0,1 MSPS hasta 122,88 MSPS, mientras que en configuración MIMO alcanza 80 MSPS.
La arquitectura 2×2 MIMO ofrece dos canales de recepción y dos de transmisión accesibles mediante cuatro conectores MHF4 para antenas externas.
Asimismo, la estabilidad de reloj se sitúa en 0,5 PPM, lo que resulta relevante en aplicaciones de investigación celular, enlaces de datos de alta velocidad y seguimiento satelital.
El diseño facilita configuraciones coherentes multicanal cuando se emplea sincronización de reloj externa para matrices en fase.
Integración del xSDR en plataformas M.2 y expansión GPIO
El conector de borde M.2 2230 A+E key soporta tanto USB 2.0 como PCIe 2.0 x2, permitiendo su instalación en la ranura WiFi o Bluetooth de numerosos equipos modernos.
Para sistemas sin ranura M.2, la placa mantiene compatibilidad con adaptadores USB-C, Mini PCIe y placas breakout PCIe heredadas del uSDR.
No obstante, al utilizar dichos adaptadores la configuración queda limitada a 1× RX y 1× TX salvo que se enruten manualmente las señales RF a través de los conectores MHF4.
En el apartado de componentes auxiliares, integra una EEPROM AT24CSW020 de 2 Kbit, un PHY USB USB3330, un oscilador NT2016SA de 26 MHz y un sensor de temperatura TMP114 para monitorización térmica.
El rango de alimentación abarca desde 2,85 hasta 5,5 V, lo que facilita su integración en distintas arquitecturas embebidas.
Además, dispone de un encabezado GPIO de 12+2 pines a 1,8 V compatible con el pinout del uSDR para ampliaciones específicas.
Ecosistema software abierto y compatibilidad con herramientas SDR
En el plano software, el módulo es compatible con GNU Radio, SoapySDR y srsRAN, lo que garantiza su integración en entornos abiertos de investigación LTE y 5G.
También puede utilizarse con wsdr.io, una plataforma basada en navegador que simplifica la configuración y el desarrollo de aplicaciones RF sin instalaciones complejas.
El proyecto cuenta con el respaldo de la NLnet Foundation dentro de la iniciativa WSDR cellular network initiative y adopta un enfoque completamente abierto.
Las bibliotecas de host se publican bajo licencia MIT y el gateware de la FPGA bajo CERN-OHL-P-2.0, mientras que los esquemas hardware completos se liberarán tras la campaña de financiación.
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